『SystemVerilogによる検証の基礎』はセカイモンで2a8c14bから出品され、21の入札を集めて04月09日 23時 59分に、3974円で落札されました。即決価格は3974円でした。決済方法はに対応。秋田県からの発送料は落札者が負担しました。PRオプションはストア、取りナビ(ベータ版)を利用したオークション、即買でした。
SystemVerilogによるハードウェア検証技術を詳説!検証に必要なSystemVerilogの基本知識をカバーしつつ、ランダムスティミュラスの生成、ファンクショナルカバレッジ、アサーション、さらにはUVMを利用した検証作業について、膨大な言語仕様の中から重要ポイントをピックアップし、丁寧にひもときます。コードの記述例も多数掲載。手を動かしながら読み進めることによって、複雑かつ見落としやすい仕様を、実践的に身につけられるよう工夫されています。
カテゴリー: | 本・雑誌・漫画>>>本>>>コンピュータ・IT |
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商品の状態: | 未使用に近い |
配送料の負担: | 送料込み(出品者負担) |
配送の方法: | 佐川急便/日本郵便 |
発送元の地域: | 東京都 |
発送までの日数: | 2~3日で発送 |
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